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- 1.设CPU共有16根地址线，8根数据线，并用MREQ（低电平有效）作访存控制信号，R / W 作读写命令信号（高电平为读，低电平为写）。现有下列存储芯片：ROM（2K×8位，4K×4位，8K×8位），RAM（1K×4位，2K×8位，4K×8位），及74138译码器和其他门电路（门电路自定）。试从上述规格中选用合适芯片，画出CPU和存储芯片的连接图。要求： （1）最小4K地址为系统程序区，4096~16383地址范围为用户程序区。 （2）指出选用的存储芯片类型及数量。 （3）详细画出片选逻辑。
- 2.15. 设CPU共有16根地址线，8根数据线，并用MREQ（低电平有效）作访存控制信号，R/W作读写命令信号（高电平为读，低电平为写）。现有下列存储芯片：ROM（2K×8位，4K×4位，8K×8位），RAM（1K×4位，2K×8位，4K×8位），及74138译码器和其他门电路（门电路自定）。试从上述规格中选用合适芯片，画出CPU和存储芯片的连接图。要求：（1）最小4K地址为系统程序区，4096~16383地址范围为用户程序区。（2）指出选用的存储芯片类型及数量。（3）详细画出片选逻辑。
- 3.设 CPU共有 16 根地址线,8 根数据线,并用 MREQ (低电平有效)作访存控制信号, R / W 作读写命令信号 (高电平为读, 低电平为写)。现有下列存储芯片: ROM(2K× 8 位, 4K×4 位, 8K×8 位),RAM(1K×4 位, 2K×8 位,4K×8 位),及 74138 译码器和其他门电路(门电路自定)。试从上述规格中选用合适芯片,画出 CPU和存储芯片的连接图。要求:⏺欢迎下载 23⏺—(1)最小 4K 地址为系统程序区, 4096~16383地址范围为用户程序区。(2)指出选用的存储芯片类型及数量。(3)详细画出片选逻辑。
- 4.4.15设CPU共有16根地址线,8根数据线,并用MREQ(低电平有效)作访存控制信号,R/W作读/写命令信号(高电平为读,低电平为写)。现有这些存储芯片:ROM(2K×8位,4K×4位,8K×8位),RAM(1K×4位,2 K×8位,4K×8位)及74138译码器和其他门电路(门电路自定)。试从上述规格中选用合适的芯片,画出CPU和存储芯片的连接图。要求如下﹔(1）最小4K地址为系统程序区.4096~16383地址范围为用户程序区。(2〉指出选用的存储芯片类型及数量。(3）详细画出片选逻辑。
- 5.设CPU共有16根地址线，8根数据线，并用IO/ M作访存控制信号，用R/W作读写命令信号，现有下列存储芯片及138译码器和各种门电路（自定）。RAM 2K×8位， 4K×4位， 8K×8位ROM 2K×8位， 4K×8位， 4K×16位画出CPU与存储器的连接图，要求最小8K地址空间为系统程序区，最大的4K地址空间为用户程序区；合理选用上述存储芯片，并写出每片存储芯片的地址范围；详细画出存储芯片的片选逻辑。
- 6.设cPU共有16根地址线,8根数据线,并用MREQ作访存控制信号(低电平有效),用WR作读写信号(高电平为读,低电平为写)。现有下列芯片及各种门电路(门电路自定),如图画出CPU存储器的连接图,要(1)存储芯片地址空间分配为最大4K地址空间为系统程序区相邻的4K地址空间为系统程序工作区最小16K地址空间为用户程序区(2)指出选用的存储芯片类型及数量(3)详细画出片选逻辑。ROMRAM74138译码器ROM:2K×8位RAM:IK×4位2K×8位32K×8位8K×8位C,B,A为变量控制端6K×1位Y,…Y为输出端
- 7.00.设CPU共有16根地址线,8根数据线,并用MREQ作访存控制信号(低电平有效,用WR作读写控制信号(高电平为读,低电平为写)。现有下列芯片及各种门电路门电路自定).如图1所示。画出CP存储器的连接图,要求(1)存储芯片地址空间分配为最大4K地址空间为系统程序区相邻的4K地址空间为系统程序工作区小16K地址空间为用户程序区(2)指出选用的存储芯片类型及数量(3)详细画出片选逻辑ROMRAMPD/ProgrA74138译码器ROM:2K×8位RAM:IK×4位2K×8位8K×8位C,B,A为变量控制端Y,…Y为输出图1相关的芯片和电路
- 8.设CPU共有16根地址线,8根数据线,并用MREQ作访存控制信号(低电平有效),用WR作读写控制信号(高电平为读,低电平为写)。现有下列芯片及各种门电路(门电路自定),如图1所示。画出CPU存储器的连接图,要求:(1)存情芯片地址空间分配为最大4K地址空间为系统程序区相邻的4K地址空间为系统程序工作区最小16K地址空间为用户程(2)指出选用的存储芯片类型及数量3)详细画出片选逻辑ROMRAMPD/ProgrBA74138译码器RAM:IK×4位ROM:2K×8位2K*8位8K×8位32K×8位C,B,A为变量控制端Y,…Y为
- 9.设CPU共有16根地址线,8根数据线,并用MREQ作访存控制信号(低电平有效),用WR作读写控制信号(高电平为读,低电平为写)。现有下列芯片及各种门电路(门电路自定),如图1所示。画出CPU存储器的连接图,要求:(1)存情芯片地址空间分配为最大4K地址空间为系统程序区相邻的4K地址空间为系统程序工作区v16K地址空间为用户程(2)指出选用的存储芯片类型及数量(3)详细画出片选逻辑ROMRAMPD/ProgrBA74138译码器RAM:IK×4位ROM:2K×8位2K*8位8K×8位32K×8位C,B,A为变量控制端
- 10.【简答题】设CPU共有16根地址线，8根数据线，并用作访存控制信号（低电平有效），用作读写控制信号（高电平为读，低电平为写）。现有下列存储芯片：1K×4位RAM，4K×8位RAM， 2K×8位ROM，4K×8位ROM。要求：（1）主存地址空间分配：A000H～A7FFH为系统程序区；A800H～ABFFH为用户程序区。（2）合理选用上述存储芯片，说明各选几片？
- 11.设CPU有l6根地址线，8根数据线，并用MREQ作为访存控制信号（低电平有效），用WR作为读／写控制信号（高电平为读，低电平为写）。现有下列存储芯片：1K×4位RAM， 4K×8位RAM，8Kx8位RAM．2K×8位ROM，4K×8位ROM，8K×8位ROM及74LS138译码器和各种门电路。画出CPU与存储器的连接图，要求： 1)主存地址空间分配：6000H—67FFH为系统程序区；6800H～6BFFH为用户程序区。 2)合理选用上述存储芯片，说明各选几片？ 3)详细画出存储芯片的片选逻辑图
- 12.设CPU共有16根地址线，8根数据线，并用MREQ(低电平有效)作访存控制信号，R/-W作读写命令信号（高电平为读，低电平为写），及74138译码器和其他门电路（门电路自定）。现有8片8K*8位芯片与CPU相连，试回答：（1） 用74138译码器画出CPU与存储芯片的连接图（2） 写出每片RAM的地址范围
- 13.【简答题】设CPU共有16根地址线，8根数据线，并用作为访存控制信号（低电平有效），用作为读／写控制信号（高电平为读，低电平为写）。现有芯片及各种门电路（门电路自定），如图所示。画出CPU与存储芯片的连接图，要求：（1）存储芯片地址空间分配：0～8191为系统程序区；8192～32767为用户程序区；最大4K地址空间为系统程序工作区。（2）指出选用的存储芯片类型及数量。（3）详细画出片选逻辑。
- 14.某机字长16 位，CPU地址总线18位，数据总线16位，存储器按字编址，CPU 的控制信号线有：MREQ#（存储器访问请求，低电平有效），R/W#（读写控制，低电平为写信号，高电平为读信号）。 已知该机已有8K×16位的ROM存储器，地址处于主存的最高端；现在再用若干个16K×8位的SRAM芯片形成128K×16位的RAM存储区域，起始地址为00000H，假设SRAM芯片有CS#（片选，低电平有效）和WE#（写使能，低电平有效）信号控制端；试写出RAM、ROM的地址范围，并画出SRAM、ROM与CPU的连接图，请标明SRAM芯片个数、译码器的输入输出线、地址线、数据线、控制线及其连接
- 15.【简答题】5.3 某机字长 16 位,CPU 地址总线 18 位,数据总线 16 位,存储器按字编址,CPU 的控制信号线: MREQ# (存储器访问请求,低电平有效),R/W#(读写控制,低电平为写信号,高电平为读信号)。试问: (4)已知该机已有 8K×16 位的 ROM 存储器,地址处于主存的最高端;现在再用若干个 16K×8 位SRAM 芯片形成 128K×16 位的 RAM 存储区域,起始地址为00000H,假设 SRAM 芯片有 CS#(片选,低电平有效)和 WE#(写使能,低电平有效)信号控制端;试写出 RAM、ROM 的地址范围,并画出SRAM、ROM 与CPU 的连接图,请标明SRAM 芯片个数、译码器的输入输出线、地址线、数据线、控制线及其连接
- 16.(本题共16分)某机字长8位,CPU地址总线16位,数据总线8位,存储器按字节编址,CPU的控制信号线有:MREQ#(存储器访问请求,低电平有效),R/W#(读写控制,低电平为写信号,高电平为读信号)。试问:(1)若该机主存采用16K×1位的DRAM芯片(内部为128×128阵列)构成最大主存空间,则共需多少个芯片?若采用异步刷新方式,单元刷新周期为2ms,则刷新信号的周期为多少时间?刷新用的行地址为几位?(6分)(2)若为该机配备2K×8位的Cache,每块8字节,采用2路组相联映像,试写出对主存地址各个字段的划分(标出各个字段的位数);若主存地址为3280H,则该地址可映像到Cache的哪一组?(4分)(3)若用4个8K×4位的SRAM芯片和2个4K×8位的SRAM芯片形成24K×8位的连续RAM存储区域,起始地址为0000H,假设SRAM芯片有CS#(片选,低电平有效)和WE#(写使能,低电平有效)信号控制端。试画出SRAM与CPU的连接图,在图上标清楚地址译码连接,数据线、地址线、控制线连接。(6分)
- 17.设有4K×4位SRAM芯片，欲与8088 CPU组成16K×8位的存储空间，请问需用此SRAM芯片多少片？片内地址线及片选地址线分别需要几根？假设该16K×8位存储空间连续，且末地址为FFFFFH，请画出SRAM芯片与8088 CPU的连线（只要求画出一组），并写出各芯片组的地址域。
- 18.3 某机字长16 位，CPU地址总线18位，数据总线16位，存储器按字编址，CPU 的控制信号线有：MREQ#（存储器访问请求，低电平有效），R/W#（读写控制，低电平为写信号，高电平为读信号）。试问：（1）该机可以配备的最大主存容量为 。（2）该机主存采用64K×1bit的DRAM芯片（内部为4个128×128阵列）构成最大主存空间，则共需 个芯片；若采用异步刷新方式，单元刷新间隔为2ms，则刷新信号的周期为 。（3）若为该机配备2K×16位的Cache，每块8字节，采用2路组相联映象，试写出对主存地址各个字段的划分（标出各个字段的位数）；若主存地址为462EH，则该地址可映象到Cache的哪一组？（4）已知该机已有8K×16位的ROM存储器，地址处于主存的最高端；现在再用若干个16K×8位的SRAM芯片形成128K×16位的RAM存储区域，起始地址为00000H，假设SRAM芯片有CS#（片选，低电平有效）和WE#（写使能，低电平有效）信号控制端；试写出RAM、ROM的地址范围，并画出SRAM、ROM与CPU的连接图，请标明SRAM芯片个数、译码器的输入输出线、地址线、数据线、控制线及其连接。
