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- 1.设CPU有16根地址线，8根数据线，并用MREQ#作访存控制信号（低电平有效），用R/W#作读/写控制信号（高电平为读，低电平为写）。现有下列存储芯片：1K×4位SRAM；4K × 8位SRAM；8K × 8位SRAM；2K × 8位ROM；4K × 8位ROM；8K × 8位ROM；及3：8译码器和各种门电路。 要求：主存的地址空间满足下述条件：最小8K地址为系统程序区（ROM区），与其相邻的16K地址为用户程序区（RAM区），最大4K地址空间为系统程序区（ROM区）。 ①请画出存储芯片的片选逻辑，存储芯片的种类、片数 ②画出CPU与存储器的连接图。
- 2.设CPU共有16根地址线，8根数据线，并用作访存控制信号（低电平有效）用作读写控制信号（高电平为读，低电平为写）。现有下列存储芯片：1K×4位RAM，4K×8位RAM，2K×8位ROM，以及74138译码器和各种门电路，如图所示。画出CPU与存储器连接图，要求：（1 主存地址空间分配：A000H～A7FFH为系统程序区；A800H～AFFFH为用户程序区，画出地址空间分配图。（2 合理选用上述存储芯片，说明各选几片，并写出每片存储芯片的二进制地址范围。（3 详细画出存储芯片的片选逻辑。
- 3.【简答题】设CPU共有16根地址线，8根数据线，并用作访存控制信号（低电平有效），用作读写控制信号（高电平为读，低电平为写）。现有下列存储芯片：1K×4位RAM，4K×8位RAM， 2K×8位ROM，4K×8位ROM。要求：（1）主存地址空间分配：A000H～A7FFH为系统程序区；A800H～ABFFH为用户程序区。（2）合理选用上述存储芯片，说明各选几片？
- 4.设CPU共有16根地址线，8根数据线，并用 MREQ（低电平有效）作访存控制信号， WR作读/写控制信号（高电平为读，低电平为写）。 现有存储芯片： ROM（2K*8位，4K*8位，8K*8位）RAM（1K*4位，4K*8位，8K*8位） 及74138译码器和其他门电路（门电路自定）。 其中4000H——47FFH为系统程序区，4800H——4BFFH为用户程序区。 试从上述规格中选用合适的芯片，画出CPU和存储器的连接图。要求如下： （1）合理选用上述存储芯片，说明各选几片。 （2）详细画出存储芯片的片选逻辑图。
- 5.4.15设CPU共有16根地址线,8根数据线,并用MREQ(低电平有效)作访存控制信号,R/W作读/写命令信号(高电平为读,低电平为写)。现有这些存储芯片:ROM(2K×8位,4K×4位,8K×8位),RAM(1K×4位,2 K×8位,4K×8位)及74138译码器和其他门电路(门电路自定)。试从上述规格中选用合适的芯片,画出CPU和存储芯片的连接图。要求如下﹔(1）最小4K地址为系统程序区.4096~16383地址范围为用户程序区。(2〉指出选用的存储芯片类型及数量。(3）详细画出片选逻辑。
- 6.00.设CPU共有16根地址线,8根数据线,并用MREQ作访存控制信号(低电平有效,用WR作读写控制信号(高电平为读,低电平为写)。现有下列芯片及各种门电路门电路自定).如图1所示。画出CP存储器的连接图,要求(1)存储芯片地址空间分配为最大4K地址空间为系统程序区相邻的4K地址空间为系统程序工作区小16K地址空间为用户程序区(2)指出选用的存储芯片类型及数量(3)详细画出片选逻辑ROMRAMPD/ProgrA74138译码器ROM:2K×8位RAM:IK×4位2K×8位8K×8位C,B,A为变量控制端Y,…Y为输出图1相关的芯片和电路
- 7.设CPU共有12根地址线,8根数据线,用R/W(——)作读写控制信号(高电平为读,低电平为写)。现有下列存储芯片:1K×4位RAM,4K×8位RAM,2K×8位ROM,以及各种门电路。要求主存地址空间分配:000H~7FFH为系统程序区;800H~BFFH为用户程序区。(1)试分析系统程序区和用户程序区的存储容量分别是多少。合理选用上述存储芯片,说明各选几片?(2)根据上述情况分析芯片地址与片选逻辑。(3)画出CPU与存储芯片的连接图。
- 8.设CPU共有16根地址线,8根数据线,并用MREQ (低电平有 效)作访存控制信号,R/W作读写命令信号(高电平为读,低电平 为写)。现有下列存储芯片:ROM (2KX8位,4K X4位,8KX8 位),RAM (1KX4位,2KX8位,4KX8位),及74138译码器和 其他门电路(门电路自定)。试从上述规格中选用合适芯片,画出 CPU和存储芯片的连接图。要求:(1) 最小4K地址为系统程序区,4096~16383地址范围为用户 程序区。(2) 指出选用的存储芯片类型及数量。(3) 详细画出片选逻辑。
- 9.5.设CPU共有16根地址线,8根数据线,并用MREQ作访存控制信号(低电平有效),用WR作读写控信号(高电平为读,低电平为写)现有下列芯片及各种门电路门电路自定),如图1所示。画出CPU存储器的连接图,要求:(1)存储芯片地址空间分配为最大4K地址空间为系统程序区相邻的4K地址空间为系统程序工作区小16K地址空间为用户程序区(2)指出选用的存储芯片类型及数量(3)详细画出片选逻辑PDP ROMRAM74138译码器RAM:1K×4位ROM:2K×8位8K×8位32K×8位B,A为变量控制端16K×1位4K×4位Y,…Y。为输出
- 10.设cPU共有16根地址线,8根数据线,并用MREQ作访存控制信号(低电平有效),用wR作读写控制信号(高电平为读,低电平为写)。现有下列芯片及各种门电路(门电路自定),如图1所示。画出CPU存储器的连接图,要求:(1)存情芯片地址空间分配为最大4K地址空间为系统程序区相邻的4K地址空间为系统程序工作区v16K地址空间为用户程(2)指出选用的存储芯片类型及数量(3)详细画出片选逻辑ROMRAMPD/ProgrcBA74138译码器RAM:IK×4位ROM:2K×8位2K*8位8K×8位32K×8位C,B,A为变量控制端Y为输出端
- 11.设CPU共有16根地址线,8根数据线,并用MREQ作访存控制信号(低电平有效),用WR作读写控制信号(高电平为读,低电平为写)。现有下列芯片及各种门电路(门电路自定),如图1所示。画出CPU存储器的连接图,要求:(1)存情芯片地址空间分配为最大4K地址空间为系统程序区相邻的4K地址空间为系统程序工作区v16K地址空间为用户程(2)指出选用的存储芯片类型及数量(3)详细画出片选逻辑ROMRAMPD/ProgrBA74138译码器RAM:IK×4位ROM:2K×8位2K*8位8K×8位32K×8位C,B,A为变量控制端
- 12..设CPU共有16根地址线，8根数据线，并用#MREQ（低电平有效）作访存控制信号，R、#W作读写命令信号（高电平为读，低电平为写）。现有8片8K×8位的RAM芯片与CPU相连。（1）用74138译码器画出CPU与存储芯片的连接图。（2）写出每片RAM的地址范围。（3）如果运行时发现不论往哪片RAM写入数据，以A000H为起始地址的存储芯片都有与其相同的数据，分析故障原因。（4）根据（1）的连接图，若出现地址线A13与CPU断线，并搭接到高电平上，将出现什么后果？
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13.某机器中,已知配有一个地址空间为0000H~1FFFH(16进制)字长16位的ROM区域。 现在再用RAM芯片(8K×8位)形成16K×16位的RAM区域,起始地址为2000H。 假设RAM芯片有CS和WE信号控制端。CPU地址总线为A15~A0,数据总 线为D13~D,控制信号为R/W(读/写),MREQ(当存储器进行读或写操作时,该信号指 示地址总线上的地址是有效的)。要求: (1)画出地址译码方案。 (2)将ROM和RAM同CPU连接。 选项： A:
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- 14.一台8 位微机系统（CPU 为8088）需扩展内存16K，其中ROM 为8K，RAM 为8K。ROM 选用EPROM2716，RAM 选用2114，地址空间从0000H 开始，要求ROM 在低地址，RAM 在高地址，连续存放。试画出存储器组构图，并写出各芯片的地址分配范围。
- 15.3 某机字长16 位，CPU地址总线18位，数据总线16位，存储器按字编址，CPU 的控制信号线有：MREQ#（存储器访问请求，低电平有效），R/W#（读写控制，低电平为写信号，高电平为读信号）。试问：（1）该机可以配备的最大主存容量为 。（2）该机主存采用64K×1bit的DRAM芯片（内部为4个128×128阵列）构成最大主存空间，则共需 个芯片；若采用异步刷新方式，单元刷新间隔为2ms，则刷新信号的周期为 。（3）若为该机配备2K×16位的Cache，每块8字节，采用2路组相联映象，试写出对主存地址各个字段的划分（标出各个字段的位数）；若主存地址为462EH，则该地址可映象到Cache的哪一组？（4）已知该机已有8K×16位的ROM存储器，地址处于主存的最高端；现在再用若干个16K×8位的SRAM芯片形成128K×16位的RAM存储区域，起始地址为00000H，假设SRAM芯片有CS#（片选，低电平有效）和WE#（写使能，低电平有效）信号控制端；试写出RAM、ROM的地址范围，并画出SRAM、ROM与CPU的连接图，请标明SRAM芯片个数、译码器的输入输出线、地址线、数据线、控制线及其连接。
- 16.3 某机字长16 位，CPU地址总线18位，数据总线16位，存储器按字编址，CPU 的控制信号线有：MREQ#（存储器访问请求，低电平有效），R/W#（读写控制，低电平为写信号，高电平为读信号）。试问：（1）该机可以配备的最大主存容量为 。（2）该机主存采用64K×1bit的DRAM芯片（内部为4个128×128阵列）构成最大主存空间，则共需 个芯片；若采用异步刷新方式，单元刷新间隔为2ms，则刷新信号的周期为 。（3）若为该机配备2K×16位的Cache，每块8字节，采用2路组相联映象，试写出对主存地址各个字段的划分（标出各个字段的位数）；若主存地址为462EH，则该地址可映象到Cache的哪一组？（4）已知该机已有8K×16位的ROM存储器，地址处于主存的最高端；现在再用若干个16K×8位的SRAM芯片形成128K×16位的RAM存储区域，起始地址为00000H，假设SRAM芯片有CS#（片选，低电平有效）和WE#（写使能，低电平有效）信号控制端；试写出RAM、ROM的地址范围，并画出SRAM、ROM与CPU的连接图，请标明SRAM芯片个数、译码器的输入输出线、地址线、数据线、控制线及其连接。
