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下列哪个不是Verilog HDL的关键字?( )
选项:
A:module
B:and
C:assign
D:mem
关键字
下列
发布时间:
2024-05-16 00:14:32
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1.
下列哪个不是 Verilog HDL 的关键字?( )A.ifB.alwaysC.casezD.forE.switch
2.
在Verilog HDL中,下列是描述分支语句关键字的是: 选项:if-else|module|always|input
3.
在Verilog HDL中,下列是描述分支语句关键字的是: 选项:A、if-else B、module C、always D、input
4.
在verilog HDL中,下列语句哪个不是循环语句?选项: A:casez; B:for; C:while; D:repeat
5.
在verilog HDL中,下列语句哪个不是循环语句?( )选项: A:while; B:for; C:casez; D:repeat
6.
Verilog HDL用来定义模块的关键字是: 和 。
7.
【单选题】以下属于Verilog HDL语言的关键词的是( ) 选项: A、MODULE B、IF C、While D、case
8.
当使用Verilog HDL描述组合逻辑电路时,只能使用assign语句进行描述。
9.
在Verilog HDL中,多条assign语句的执行按照语句的先后顺序,而assign语句和always语句之间是并行执行的。( )选项: A:对 B:错
10.
下列关于Verilog HDL语言的描述中,不正确的选项是( )。 选项: A、 Verilog HDL可实现并行计算,C语言知识串行计算; B、 Verilog HDL语言可以描述电路结构,C语言仅仅描述算法; C、 Verilog HDL语言源于C语言,包括它的逻辑和延迟; D、 Verilog HDL可以编写测试向量进行仿真和测试。
11.
采用Verilog硬件描述语言进行设计输入时,应该选择的文件类型为 选项: A、Verilog Module B、Verilog Test Fixture C、VHDL Module D、VHDL Package
12.
Verilog HDL的端口声明语句中,用( )关键字声明端口为双向端口。选项: A:buffer B:BUFFER C:INOUT D:inout
13.
Verilog HDL的端口声明语句中,用( )关键字声明端口为双向端口。选项: A:inout B:INOUT C:buffer D:BUFFER
14.
Verilog HDL的端口声明语句中,用( )关键字声明端口为双向端口。选项: A:BUFFER B:inout C:buffer D:INOUT
15.
在Verilog HDL的端口声明语句中,用( )关键字声明端口为输入方向。 选项: A、input B、INPUT C、IN D、output
16.
在Verilog HDL的端口声明语句中,用( )关键字声明端口为双向方向。 选项: A、inout B、INOUT C、BUFFER D、buffer
17.
在Verilog HDL的端口声明语句中,用( )关键字声明端口为输出方向。 选项: A、input B、INPUT C、OUT D、output
18.
下列关于Verilog HDL语言的描述中,不正确的是 () 选项: A:与C语言类似,Venlog HDL中的变量需要先声明后使用 B:调整设计代码中不同的alwavs块的顺序会得到不同的硬件结构 C:Verilog HDL既可以用于描述硬件结构,又可以用于描述仿真测话 D:设计代码中,不同的assign块之间的语义是并发执行的
19.
Verilog中的“assign”关键字的作用是什么( ) 选项: A、定义模块的输入和输出端口 B、定义变量 C、定义组合逻辑 D、定义时序逻辑
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