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- 1.若D触发器的现态为0，要使D触发器的次态Qn+1为1，应满足如下条件（）。选项： A:SD=1、RD=1、CP上升沿、D=1; B:SD=1、RD=0、CP上升沿、D=1; C:SD=1、RD=1、CP下降沿、D=1; D:SD=1、RD=0、CP下降沿、D=1
- 2.若JK触发器的现态为0，要使JK触发器的次态Qn+1为1，应满足如下条件（）。选项： A:SD=1、RD=1、CP上升沿、J=1、K=1; B:SD=1、RD=0、CP上升沿、J=0、K=1; C:SD=1、RD=1、CP下降沿、J=1、K=1; D:SD=1、RD=0、CP下降沿、J=0、K=1
- 3.D触发器的异步置位端SD和复位端RD都是低电平有效，要使D触发器的现态Qn为1，应满足如下条件
- 4.由与非门构成的基本RS触发器，要使Qn+1=0,则输入信号应为( ) 选项：A、SD=RD=1 B、SD=RD=0 C、SD=1,RD=0 D、SD=0,RD=1
- 5.由与非门构成的RS触发器,要使Qn 1=0,则输入信号应为（）A.SD=RD=1B.SD=RD=0C.SD=1,RD=0D.SD=0,RD=1
- 6.用两个或非门组成的基本RS触发器,其输入信号Rd、Sd必须满足的约束条件是《》 选项： A、Rd+Sd=0； B、RdSd=1 C、RdSd=0 D、Rd+Sd=1。
- 7.与非门构成的基本RS触发器的输入/Sd=0，/Rd=0时，原态为0，其输出状态为Q、/Q（）。，“/Rd”和”/Sd“表示低电平有效 选项： A:00; B:01; C:10; D:11
- 8.与非门构成的基本RS触发器的输入/Sd=0，/Rd=0时，原态为0，其输出状态为Q、/Q（）。，“/Rd”和”/Sd“表示低电平有效选项： A:00; B:01; C:10; D:11
- 9.与非门构成的基本RS触发器的输入/Sd=0，/Rd=0时，原态为0，其输出状态为Q、/Q（）。，“/Rd”和”/Sd“表示低电平有效 选项： A、00 B、01 C、10 D、11
- 10.与非门构成的基本RS触发器的输入/Sd=0，/Rd=0时，原态为0，其输出状态为Q、/Q（）。，“/Rd”和”/Sd“表示低电平有效 选项：A、11 B、00 C、01 D、10
- 11.与非门构成的基本RS触发器的输入/Sd=0，/Rd=0时，原态为0，其输出状态为Q、/Q（）。，“/Rd”和”/Sd“表示低电平有效 A: 00 B: 01 C: 10 D: 11
- 12.用与非门构成的基本RS触发器处于0状态时，其输入信号/Rd/Sd应为( )，“/Rd”和”/Sd“表示低电平有效选项： A:01; B:10; C:11; D:00
- 13.用与非门构成的基本RS触发器处于0状态时，其输入信号/Rd/Sd应为( )，“/Rd”和”/Sd“表示低电平有效 选项： A:01; B:10; C:11; D:00
- 14.用与非门构成的基本RS触发器处于0状态时，其输入信号/Rd/Sd应为( )，“/Rd”和”/Sd“表示低电平有效 选项： A、01 B、10 C、11 D、00
- 15.由与非门组成的基本RS触发器在输入RD’、SD’同时由0变1后，触发器的状态为（）。 选项： A、0状态 B、 1状态 C、 状态不变 D、 状态不定
- 16.在图示逻辑电路中，触发器的初始状态是“1”态，当RD端保持高电平，在SD端加一负脉冲时，触发器的新态是 。A、翻转到“0”态B、保持“1”态C、先翻转到“0”，马上回到“1”态D、无规律翻转．不能确定
- 17.由TTL与非门构成的基本RS触发器，当RD=SD=1时，触发器处于不定状态。（ ）
- 18.对存储器进行读操作时8086CPU输出控制信号有效是( ) （*表示该信号为低电平） 选项： A、RD* = 0和M / IO *= 1 B、RD *= 0和M / IO* = 0 C、RD* = 1和M / IO *= 1 D、RD*= 1和M / IO* = 0
- 19.对存储器进行读操作时,8086CPU输出控制信号有效是( ) (*表示该信号为低电平) 选项： A、RD *= 0和IO / M * = 1 B、RD* = 1和IO / M *= 1 C、RD*= 1和IO /M * = 0 D、RD* = 0和IO /M *= 0
- 20.一个同步RS触发器，R为复位端，S为置位端，它们均为低电平有效，若CP=0，R=1，S=0，则该触发器Q端的状态（） 选项： A、维持不变 B、变为0 C、变为1 D、无法判断
