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- 1.4.15设CPU共有16根地址线,8根数据线,并用MREQ(低电平有效)作访存控制信号,R/W作读/写命令信号(高电平为读,低电平为写)。现有这些存储芯片:ROM(2K×8位,4K×4位,8K×8位),RAM(1K×4位,2 K×8位,4K×8位)及74138译码器和其他门电路(门电路自定)。试从上述规格中选用合适的芯片,画出CPU和存储芯片的连接图。要求如下﹔(1）最小4K地址为系统程序区.4096~16383地址范围为用户程序区。(2〉指出选用的存储芯片类型及数量。(3）详细画出片选逻辑。
- 2.设cPU共有16根地址线,8根数据线,并用MREQ作访存控制信号(低电平有效),用WR作读写信号(高电平为读,低电平为写)。现有下列芯片及各种门电路(门电路自定),如图画出CPU存储器的连接图,要(1)存储芯片地址空间分配为最大4K地址空间为系统程序区相邻的4K地址空间为系统程序工作区最小16K地址空间为用户程序区(2)指出选用的存储芯片类型及数量(3)详细画出片选逻辑。ROMRAM74138译码器ROM:2K×8位RAM:IK×4位2K×8位32K×8位8K×8位C,B,A为变量控制端6K×1位Y,…Y为输出端
- 3.00.设CPU共有16根地址线,8根数据线,并用MREQ作访存控制信号(低电平有效,用WR作读写控制信号(高电平为读,低电平为写)。现有下列芯片及各种门电路门电路自定).如图1所示。画出CP存储器的连接图,要求(1)存储芯片地址空间分配为最大4K地址空间为系统程序区相邻的4K地址空间为系统程序工作区小16K地址空间为用户程序区(2)指出选用的存储芯片类型及数量(3)详细画出片选逻辑ROMRAMPD/ProgrA74138译码器ROM:2K×8位RAM:IK×4位2K×8位8K×8位C,B,A为变量控制端Y,…Y为输出图1相关的芯片和电路
- 4.设CPU有16根地址线，8根数据线，并用MREQ#作访存控制信号（低电平有效），用R/W#作读/写控制信号（高电平为读，低电平为写）。现有下列存储芯片：1K×4位SRAM；4K × 8位SRAM；8K × 8位SRAM；2K × 8位ROM；4K × 8位ROM；8K × 8位ROM；及3：8译码器和各种门电路。 要求：主存的地址空间满足下述条件：最小8K地址为系统程序区（ROM区），与其相邻的16K地址为用户程序区（RAM区），最大4K地址空间为系统程序区（ROM区）。 ①请画出存储芯片的片选逻辑，存储芯片的种类、片数 ②画出CPU与存储器的连接图。
- 5.设CPU共有16根地址线,8根数据线,并用MREQ作访存控制信号(低电平有效),用WR作读写控制信号(高电平为读,低电平为写)。现有下列芯片及各种门电路(门电路自定),如图1所示。画出CPU存储器的连接图,要求:(1)存情芯片地址空间分配为最大4K地址空间为系统程序区相邻的4K地址空间为系统程序工作区最小16K地址空间为用户程(2)指出选用的存储芯片类型及数量3)详细画出片选逻辑ROMRAMPD/ProgrBA74138译码器RAM:IK×4位ROM:2K×8位2K*8位8K×8位32K×8位C,B,A为变量控制端Y,…Y为
- 6.设CPU有l6根地址线，8根数据线，并用MREQ作为访存控制信号（低电平有效），用WR作为读／写控制信号（高电平为读，低电平为写）。现有下列存储芯片：1K×4位RAM， 4K×8位RAM，8Kx8位RAM．2K×8位ROM，4K×8位ROM，8K×8位ROM及74LS138译码器和各种门电路。画出CPU与存储器的连接图，要求： 1)主存地址空间分配：6000H—67FFH为系统程序区；6800H～6BFFH为用户程序区。 2)合理选用上述存储芯片，说明各选几片？ 3)详细画出存储芯片的片选逻辑图
- 7.设CPU共有16根地址线，8根数据线，并用作访存控制信号（低电平有效）用作读写控制信号（高电平为读，低电平为写）。现有下列存储芯片：1K×4位RAM，4K×8位RAM，2K×8位ROM，以及74138译码器和各种门电路，如图所示。画出CPU与存储器连接图，要求：（1 主存地址空间分配：A000H～A7FFH为系统程序区；A800H～AFFFH为用户程序区，画出地址空间分配图。（2 合理选用上述存储芯片，说明各选几片，并写出每片存储芯片的二进制地址范围。（3 详细画出存储芯片的片选逻辑。
- 8.设CPU有16根地址线，8根数据线，并用作访存控制信号（低电平有效），用作读/写控制信号（高电平为读，低电平为写）。现有下列存储芯片：1K×4位RAM；4K×8位RAM；8K×8位RAM；2K×8位ROM；4K×8位ROM；8K×8位ROM及74LS138译码器和各种门电路，如图所示。画出CPU与存储器的连接图，要求：（1 主存地址空间分配：6000H～67FFH为系统程序区；6800H～6BFFH为用户程序区。写出地址空间分配表。（2 合理选用上述存储芯片，说明各选几片？（3 详细画出存储芯片的片选逻辑图。
- 9.【简答题】设CPU共有16根地址线，8根数据线，并用作访存控制信号（低电平有效），用作读写控制信号（高电平为读，低电平为写）。现有下列存储芯片：1K×4位RAM，4K×8位RAM， 2K×8位ROM，4K×8位ROM。要求：（1）主存地址空间分配：A000H～A7FFH为系统程序区；A800H～ABFFH为用户程序区。（2）合理选用上述存储芯片，说明各选几片？
- 10.设CPU共有12根地址线,8根数据线,用R/W(——)作读写控制信号(高电平为读,低电平为写)。现有下列存储芯片:1K×4位RAM,4K×8位RAM,2K×8位ROM,以及各种门电路。要求主存地址空间分配:000H~7FFH为系统程序区;800H~BFFH为用户程序区。(1)试分析系统程序区和用户程序区的存储容量分别是多少。合理选用上述存储芯片,说明各选几片?(2)根据上述情况分析芯片地址与片选逻辑。(3)画出CPU与存储芯片的连接图。
- 11.3 某机字长16 位，CPU地址总线18位，数据总线16位，存储器按字编址，CPU 的控制信号线有：MREQ#（存储器访问请求，低电平有效），R/W#（读写控制，低电平为写信号，高电平为读信号）。试问：（1）该机可以配备的最大主存容量为 。（2）该机主存采用64K×1bit的DRAM芯片（内部为4个128×128阵列）构成最大主存空间，则共需 个芯片；若采用异步刷新方式，单元刷新间隔为2ms，则刷新信号的周期为 。（3）若为该机配备2K×16位的Cache，每块8字节，采用2路组相联映象，试写出对主存地址各个字段的划分（标出各个字段的位数）；若主存地址为462EH，则该地址可映象到Cache的哪一组？（4）已知该机已有8K×16位的ROM存储器，地址处于主存的最高端；现在再用若干个16K×8位的SRAM芯片形成128K×16位的RAM存储区域，起始地址为00000H，假设SRAM芯片有CS#（片选，低电平有效）和WE#（写使能，低电平有效）信号控制端；试写出RAM、ROM的地址范围，并画出SRAM、ROM与CPU的连接图，请标明SRAM芯片个数、译码器的输入输出线、地址线、数据线、控制线及其连接。
- 12.【计算题】某机字长16位,CPU地址总线18位,数据总线16位,存储器按字编址,CPU的控制信号有:MREQ#(存储器访问请求,低电平有效),R/W#(读写控制,低电平为写信号,高电平为读信号)。试问: (1)该机可以配备的最大主存容量为__________。 (2)该机主存采用64K×1位的DRAM芯片(内部为4个128×128阵列)构成最大主存空间___________,则共需____________个芯片;若采用异步刷新方式,单元刷新间隔为2ms,则刷新信号的周期为______________。 (3)若为该机配备2K×16位的Cache,每块8B,采用2路组相联映射方式,试写出对主存地址各个字段的划分(标出各个字段的位数);若主存地址为462EH,则该地址可映射到Cache的哪一组? (4)若该机已有8K×16位的ROM存储器,地址处于主存的最高端,现在再用若干个16K×8位的SRAM芯片形成128K×16位的RAM存储区域,起始地址为00000H,假设SRAM芯片有CS#(片选,低电平有效)和WE#(写使能,低电平有效)信号控制端;试写出RAM,ROM的地址范围,并画出SRAM,ROM
- 13.设有若干片256K×8位的SRAM芯片,问: (1) 如何构成2048K×32位的存储器(2分) (2) 需要多少片RAM芯片(2分) (3) 该存储器需要多少字节地址位(2分) (4) 画出该存储器与CPU连接的结构图,设CPU的接口信号有地址信号、数据信号、控制信号MREQ#和R/W#。(4分)
