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- 1.多位加法器的构成有两种方式：并行进位和串行进位。其中并行进位方式设有进位产生逻辑，运算速度较快；串行进位方式是将全加器级联构成多位加法器，运行速度较慢。选项： A:对 B:错
- 2.多位加法器的构成有两种方式：并行进位和串行进位。其中并行进位方式设有进位产生逻辑，运算速度较快；串行进位方式是将全加器级联构成多位加法器，运行速度较慢。A．正确B．错误
- 3.以下关于串行加法器与并行加法器的描述中，错误的是（） 选项： A、相对并行进位，串行进位的处理速度较慢 B、串行加法器只有一个全加器，并行加法器有多个全加器 C、若采用并行加法器的分组并行进位方式，那么在组间可采用串行进位方式 D、并行加法器的并行进位方式较容易实现
- 4.以下关于串行加法器与并行加法器的描述中 , 错误的是 ( ) 。A.串行加法器只有一个全加器 , 并行加法器有多个全加器B.相对并行进位 , 串行进位的处理速度较慢C.并行加法器的并行进位方式容易实现D.若采用并行加法器的分组并行进位方式 , 那么在组间可采用串行进位方式
- 5.（填空）串行进位的加法器和并行进位的加法器相比，运算速度 。
- 6.以下关于加法器的描述中，错误的是（ ）。? 相对并行进位，串行进位的处理速度较慢|算术逻辑单元的核心部件是加法器|串行加法器只有一个全加器，并行加法器有多个全加器|多个半加器无法实现多位二进制数的加法
- 7.以下关于加法器的描述中，错误的是（ ）。? 串行加法器只有一个全加器，并行加法器有多个全加器相对并行进位，串行进位的处理速度较慢多个半加器无法实现多位二进制数的加法算术逻辑单元的核心部件是加法器
- 8.以下关于加法器的描述中，错误的是（ ）。? 串行加法器只有一个全加器，并行加法器有多个全加器相对并行进位，串行进位的处理速度较慢算术逻辑单元的核心部件是加法器多个半加器无法实现多位二进制数的加法
- 9.以下关于加法器的描述中，错误的是（ ）。? 相对并行进位，串行进位的处理速度较慢算术逻辑单元的核心部件是加法器串行加法器只有一个全加器，并行加法器有多个全加器多个半加器无法实现多位二进制数的加法
- 10.串行进位的加法器比并行加法器的运算速度更快。
- 11.以下关于加法器的描述中，错误的是（ ）。A．多个半加器无法实现多位二进制数的加法B．算术逻辑单元的核心部件是加法器C．相对并行进位，串行进位的处理速度较慢D．串行加法器只有一个全加器，并行加法器有多个全加器
- 12.以下关于快速进位链的描述正确的是___选项： A:串行进位链是指串行加法器中的进位信号采用串行传递; B:并行进位链通常有单重分组和双重分组两种实现方案; C:并行进位链是指串行加法器中的进位信号采用并行传递; D:并行进位链又可称为先行进位和跳跃进位
- 13.串行进位二进制并行加法器是由（ ）级联构成的。 选项： A:半加器; B:全加器; C:减法器; D:乘法器
- 14.超前进位加法器和串行进位加法器相比，其电路更复杂，所以电路运算速度更慢。对吗？选项： A:正确; B:错误
- 15.超前进位加法器和串行进位加法器相比，其电路更复杂，所以电路运算速度更慢。对吗？ 选项： A、正确 B、错误
- 16.加法器采用先行进位的目的是____? 选项： A、优化加法器结构 B、提高进位产生速度 C、保证运算结果正确 D、正确传递进位
- 17.加法器采用先行进位的目的是（） 选项： A、优化加法器结构 B、提高进位产生速度 C、保证运算结果正确 D、正确传递进位值
- 18.超前进位的多位加法运算电路比串行进位的多位加法运算电路速度快，这个说法是否正确？选项： A:正确; B:错误
- 19.串行进位加法器的缺点是运算速度慢，优点是电路结构简单。超前进位加法器的优点是运算速度快，缺点是电路结构复杂。A．对B．错
- 20.串行进位加法器的缺点是运算速度慢，优点是电路结构简单。超前进位加法器的优点是运算速度快，缺点是电路结构复杂。A.对B.错
- 21.串行进位加法器的缺点是运算速度慢，优点是电路结构简单。超前进位加法器的优点是运算速度快，缺点是电路结构复杂。（ ）
