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- 1.以下关于串行加法器与并行加法器的描述中，错误的是（）选项： A:相对并行进位，串行进位的处理速度较慢; B:串行加法器只有一个全加器，并行加法器有多个全加器; C:若采用并行加法器的分组并行进位方式，那么在组间可采用串行进位方式; D:并行加法器的并行进位方式较容易实现
- 2.并行进位加法器与串行进位加法器相比， 进位加法器的速度更高。
- 3.多位加法器的构成有两种方式：并行进位和串行进位。其中并行进位方式设有进位产生逻辑，运算速度较快；串行进位方式是将全加器级联构成多位加法器，运行速度较慢。选项： A:对 B:错
- 4.二进制并行加法器按其进位方式不同，可以分为串行进位二进制并行加法器和（ ）。选项： A:无进位加法器; B:超前进位二进制加法器; C:并行进位加法器; D:逐次进位加法器
- 5.（填空）串行进位的加法器和并行进位的加法器相比，运算速度 。
- 6.并行（超前）进位加法器工作速度（），但电路（）；串行进位工速度（），但电路（）。
- 7.以下关于加法器的描述中，错误的是（ ）。? 相对并行进位，串行进位的处理速度较慢|算术逻辑单元的核心部件是加法器|串行加法器只有一个全加器，并行加法器有多个全加器|多个半加器无法实现多位二进制数的加法
- 8.以下关于加法器的描述中，错误的是（ ）。? 串行加法器只有一个全加器，并行加法器有多个全加器相对并行进位，串行进位的处理速度较慢多个半加器无法实现多位二进制数的加法算术逻辑单元的核心部件是加法器
- 9.以下关于加法器的描述中，错误的是（ ）。? 串行加法器只有一个全加器，并行加法器有多个全加器相对并行进位，串行进位的处理速度较慢算术逻辑单元的核心部件是加法器多个半加器无法实现多位二进制数的加法
- 10.以下关于加法器的描述中，错误的是（ ）。? 相对并行进位，串行进位的处理速度较慢算术逻辑单元的核心部件是加法器串行加法器只有一个全加器，并行加法器有多个全加器多个半加器无法实现多位二进制数的加法
- 11.以下关于加法器的描述中，错误的是（ ）。A．多个半加器无法实现多位二进制数的加法B．算术逻辑单元的核心部件是加法器C．相对并行进位，串行进位的处理速度较慢D．串行加法器只有一个全加器，并行加法器有多个全加器
- 12.加法器采用先行进位的目的是 （ ）。? 增强加法器结构加速传递进位信号节省器材优化加法器的结构
- 13.加法器采用先行进位的目的是（） 选项： A、优化加法器结构 B、提高进位产生速度 C、保证运算结果正确 D、正确传递进位值
- 14.加法器采用先行进位的目的是 （ ）。? 增强加法器结构节省器材加速传递进位信号优化加法器的结构
- 15.加法器采用先行进位的目的是( )A、优化加法器的结构B、加速进位位的产生C、保证运算结果正确D、正确传递进位位
- 16.加法器采用先行进位的目的是______ 。 选项：优化加法器的结构；|节省器材；|加速传递进位信号；|增强加法器结构。
