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设计一个时序逻辑电路,具有20个循环状态,至少需要5个触发器。
选项:
A:正确;
B:错误
发布时间:
2024-06-03 16:09:33
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相关试题
1.
设计同步时序逻辑电路时,若有6个状态,至少需要选用( )个触发器。 选项: A、 1 B、 2 C、 3 D、 4
2.
已知一个时序逻辑电路有9个状态,那么至少应该选择3个触发器才能实现该电路。 选项: A、正确 B、错误
3.
已知一个时序逻辑电路有9个状态,那么至少应该选择3个触发器才能实现该电路。
4.
中国大学MOOC: 已知一个时序逻辑电路有9个状态,那么至少应该选择3个触发器才能实现该电路。
5.
时序逻辑电路由触发器和组合逻辑电路组成. 选项: A:正确 B:错误
6.
时序逻辑电路通常由组合逻辑电路和具有记忆功能的触发器两部分组成。 选项: A、正确 B、错误
7.
一个同步时序逻辑电路如果采用宏单元模型来设计,要求该逻辑电路共输出4路信号,而这些输出信号共有7种电平组合,那么至少需要几个D触发器才能实现该设计____。 选项:A、7个 B、4个 C、3个 D、1个
8.
一个同步时序逻辑电路如果采用宏单元模型来设计,要求该逻辑电路共输出4路信号,而这些输出信号共有7种电平组合,那么至少需要几个D触发器才能实现该设计 ____ 。选项: A:1个; B:3个 ; C:4个; D:7个
9.
时序逻辑电路的基本单元是触发器。 选项: A:正确 B:错误
10.
一个同步时序逻辑电路如果采用宏单元模型来设计,要求该逻辑电路共输出4路信号,而这些输出信号共有7种电平组合,那么至少需要几个D触发器才能实现该设计 ____ 。 A: 1个 B: 3个 C: 4个 D: 7个
11.
时序逻辑电路的特点是( )。 选项: A:时序逻辑电路任何时刻的输出状态与该电路当时的输入有关 B:时序逻辑电路任何时刻的输出状态与电路过去的状态有关 C:时序逻辑电路具有“记忆”功能 D:时序逻辑电路不具有“记忆”功能
12.
具有N个独立状态,计满N个计数脉冲后,状态能进入循环的时序逻辑电路,称为N进制计数器。A.正确B.错误
13.
时序逻辑电路按电路中触发器状态变化是否同步可分为 时序电路和异步时序电路。
14.
时序逻辑电路中的基本单元电路是触发器 选项: A:正确; B:错误
15.
时序逻辑电路的基本单元是触发器。( )A.正确B.错误
16.
由3个JK触发器构成的时序逻辑电路如下图,下面关于电路的描述正确的有 选项: A、这是一个同步时序逻辑电路 B、这是一个异步时序逻辑电路 C、3个JK触发器均构成了T′触发器,所以都满足Q*=Q′ D、3个JK触发器均是下降沿触发,因此是主从结构的触发器
17.
具有记忆功能的逻辑电路是( )。 选项: A:组合逻辑电路 B:时序逻辑电路 C:基本门电路 D:触发器
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