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- 1.A引脚信号WR=0, CS=0, A1=1, A0=1时，表示____。 选项： A:CPU向数据口写数据 B:CPU读8255控制口 C:CPU向控制口送控制字 D:无效操作
- 2.要想把数字送入DAC0的输入缓冲器,其控制信号应满足()。 选项： A、ILE=1、CS=1、WR1=0 B、ILE=1、CS=0、WR1=0 C、ILE=0、CS=1、WR1=0 D、ILE=0、CS=0、WR1=0
- 3.要想把数字送入DAC0832的输入缓冲器，其控制信号应满足（）。选项： A:ILE=1,CS =1,WR1=0; B:ILE=1,CS =0,WR1 =0; C:ILE=0, CS =1, WR1 =0; D:ILE=0,CS =0, WR1 =0
- 4.要想把数字送入DAC0832的输入缓冲器，其控制信号应满足（）。选项： A:ILE=1,CS =1,WR1=0; B:ILE=0,CS =0, WR1 =0; C:ILE=1,CS =0,WR1 =0; D:ILE=0, CS =1, WR1 =0
- 5.要想把数字送入DAC0的输入缓冲器，其控制信号应满足（ ）。 选项：ILE=1、CS=1、WR1=0#ILE=1、CS=0、WR1=0#ILE=0、CS=1、WR1=0#ILE=0、CS=0、WR1=0
- 6.当DAC0832的8位输入寄存器设置为数据直通方式时,控制信号状态应为( )。 选项： A、ILE=1,~WR1=0,~CS=0 B、ILE=1,~WR1=1,~CS=0 C、ILE=0,~WR1=0,~CS=0 D、ILE=0,~WR1=1,~CS=0
- 7.要想把数字送入DAC0832的输入缓冲器，其控制信号应满足（）。? ILE=1,CS =1,WR1=0ILE=0, CS =1, WR1 =0ILE=1,CS =0,WR1 =0ILE=0,CS =0, WR1 =0
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8.要想把数字送入DAC0832 的输入缓冲器，其控制信号应满足( )。 选项： A:
ILE=1,cs=1，WR₁=0
B:ILE=1,cs=0,WR₁=0
C:ILE=0,cs=1,WR₁=0
D:ILE=0,cs=0,WR₁=0
- 9.对存储器进行读操作时,8086CPU输出控制信号有效是( ) (*表示该信号为低电平) 选项： A、RD *= 0和IO / M * = 1 B、RD* = 1和IO / M *= 1 C、RD*= 1和IO /M * = 0 D、RD* = 0和IO /M *= 0
- 10.对存储器进行读操作时8086CPU输出控制信号有效是( ) （*表示该信号为低电平）选项： A:RD* = 0和M / IO *= 1 ; B:RD *= 0和M / IO* = 0; C:RD* = 1和M / IO *= 1 ; D:RD*= 1和M / IO* = 0
- 11.对存储器进行读操作时8086CPU输出控制信号有效是( ) （*表示该信号为低电平） 选项： A、RD* = 0和M / IO *= 1 B、RD *= 0和M / IO* = 0 C、RD* = 1和M / IO *= 1 D、RD*= 1和M / IO* = 0
- 12.8253的引脚信号A1、A0的功能是（ ）。 选项： A、片选 B、端口选择 C、读控制 D、写控制
- 13.由( )引脚的连接状态,可以确定8255的端口地址A．/RD,/CSB．/WR,A0C．A0, A1D．A0, A1,/CS
- 14.module FDIV0(input CLK, RST,input [3:0] D, output PM, output [3:0] DOUT);reg [3:0] Q1; reg FULL;wire LD;always@(posedge CLK or negedge RST) if (!RST) begin Q1<=0; FULL<=0; end else if (LD) begin Q1<=D; FULL<=1; end else begin Q1<=Q1 1; FULL<=0; endassign LD=(Q1==4'b1111); assign PM=FULL; assign DOUT=Q1;endmodule该模块实现的功能是：? 同步加载计数器同步清零加载计数器异步清零加载计数器异步加载计数器
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15.要想把数字送入DACO832的输入缓冲器，其控制信号应满足( )。 选项： A:
ILE=1,CS=1,WR₁=0
B:ILE=1,CS=0. WR₁=0
C:ILE=0,CS=1,WR₁=0
D:ILE=0,CS=0,WR₁=0
- 16.51单片机的定时/计数器的方式0为()位计数器。 选项： A、8 B、13 C、16 D、自动重装入的8位计数器
- 17.module FDIV0(input CLK, RST,input [3:0] D, output PM, output [3:0] DOUT);reg [3:0] Q1; reg FULL;wire LD;always@(posedge CLK or negedge RST) if (!RST) begin Q1<=0; FULL<=0; end else if (LD) begin Q1<=D; FULL<=1; end else begin Q1<=Q1+1; FULL<=0; endassign LD=(Q1==4'b1111); assign PM=FULL; assign DOUT=Q1;endmodule该模块实现的功能是：选项： A:同步加载计数器; B:异步加载计数器; C:同步清零加载计数器; D:异步清零加载计数器
- 18.下面关于计数器74161的说法哪些是正确的： 选项： A、清零端CLR是异步工作的，当CLR=‘0’的时候，计数器清零； B、置数端LOAD是同步工作的，当LOAD=‘0’的时候，计数器立即将输入值D3D2D1D0置到输出端； C、当计数器使能端ENT和ENP都为’0’时，计数器保持当前的计数值不变； D、只有当计数器记到“1111”的时候，计数器进位输出端RCO输出‘1‘，其他时候输出‘0’；
