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- 1.用或非门设计一个组合电路，其输入为8421BCD码，输出L。当输入数能被4整除时输出为1，其它情况下为0；下列设计正确的逻辑电路是。
- 2.设计一个组合逻辑电路，其输入为8421BCD码，当输入为偶数时，输出为1。 （1）列出真值表； （2）写出输出的最简与或表达式； （3）用门电路实现该组合逻辑电路
- 3.用或非门设计一个组合电路,其输入DCBA为8421BCD码,输出为L,当输入数能被4整除时为1,其它情况下为0;下列设计正确的逻辑电路是
- 4.用或非门设计一个组合电路,其输入DCBA为8421BCD码,输出为L,当输入数能被4整除时为1,其它情况下为0;下列设计正确的逻辑电路是
- 5.用与非门设计一个组合逻辑电路，该电路输入为一位十进制数的5421码，当输入的数为素数时，输出F为1，否则F为0。（要求写出输出函数表达式，画出逻辑电路图）
- 6.中国大学MOOC: 用与非门设计一个1位数值范围判别电路。十进制数用8421BCD码表示。当输入的十进制数大于等于5时，电路输出为1，当输入的十进制数小于等于4时，输出为0。画逻辑电路图是( )
- 7.试用2输入或非门设计一个组合逻辑电路，实现当输入是大于等于0小于3的整数时输出为0，当输入是大于等于3小于8的整数时输出为1. 要求列出真值表，写出逻辑函数表达式，并画出电路图。
- 8.当七段显示译码器的七个输出端状态为abcdefg=0011111时(高电平有效),设码器输入状态(8421BCD码)应为()A.0101B.0011C.0100D.0110
- 9. 试用4位二进制加法器74HC283设计一个码转换电路,将余三码转换为8421BCD码。
- 10.实现8421BCD码到余3码的转换规则为，余3码=8421BCD码+0011。（ ） 选项： A:对 B:错
- 11.当七段显示译码器的七个输出端状态为abcdefg=0011111时（高电平有效），译码器输入状态（8421BCD码）应为0110。选项： A:正确; B:错误
- 12.中国大学MOOC: 当七段显示译码器的七个输出端状态为abcdefg=0011111时（高电平有效），译码器输入状态（8421BCD码）应为0110。
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13.二、<12分)设8421BCD码ABCD的十进制数为N
0),当N能被3或4整除时,输出L为高电平1。列出该逻辑电路的真值表,写出该逻辑电路的逻辑表达式,并用与非门实现该逻辑电路。dvzfvkwMI1 - 14.七段显示译码器，当译码器七个输出状态为abcdefg=0011111时（高电平有效），译码器输入状态（8421BCD码）应为（ ）。选项： A:11 B:110 C:101 D:100
- 15.87用8421BCD码可表示为______ 8421BCD。
- 16.七段显示译码器，当译码器七个输出端状态为abcdefg=0011111时（高电平有效），译码器输入状态（8421BCD码）应为（ ）选项： A:0011; B:0110; C:0101; D:0100
