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- 3.由4位二进制同步计数器74LS161和与非门组成的电路如题3-32图所示，其中S1、S2为使能端，Q0～Q3为输出，CP为计数脉冲输入，为置位输入端，试判断该电路为（）进制计数器。 选项： A、十进制计数器 B、五进制计数器 C、十一进制计数器 D、十六进制计数器
- 4.163芯片接成自由计数模式后不能正常计数, 可能会有那些故障？应如何解决？
- 5.本实验D触发器构成的二位二进制计数器是（）计数器 选项： A、减计数器 B、增计数器 C、 D、
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- 7.本实验D触发器构成的二位二进制计数器是（ ）计数器 选项： A:减计数器; B: 增计数器 ; C: ; D:
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- 9.本实验D触发器构成的二位二进制计数器是 选项： A、同步计数器 B、异步计数器
- 10.下图是某计数器的状态转换图，正确的说法是（不管 ）. （2分) 选项： A: M=1时为三进制计数器、M=0时为六进制计数器 B: M=1时为六进制计数器 C: M=0时为三进制计数器 D: M=0时六进制计数器
- 11.集成二-十进制计数器可通过显示译码器将计数结果显示出来。对
- 12.本实验D触发器构成的二位二进制计数器是（ ） 选项： A:同步计数器 ; B:异步计数器 ; C:a; D:a
- 13.本实验D触发器构成的二位二进制计数器是（ ） 选项： A:同步计数器 ; B:异步计数器 ; C: ; D:
- 14.（填空）从0开始计数的N进制加法计数器，最后一个计数状态为 。
- 15.关于计数器的说法正确的是（ ）。（1.0分）0.5 分 选项： A:同步计数器中，各触发器的翻转与时钟脉冲同步 B:集成二--十进制计数器74LS90是异步十进制减法计数器。 C:计数脉冲只加到部分触发器的时钟脉冲输入端上，而其它触发器的触发信号则由电路内部提供，应翻转的触发器状态更新有先有后的计数器，称作异步计数器。 D:二进制计数器是结构最简单的计数器，但应用很广 E:随着计数脉冲的输入作递增计数的电路称作加法计数器。
- 16.本实验D触发器构成的二位二进制计数器是（ ） 选项： A:同步计数器 ; B:异步计数器 ; C: ; D:
- 17.欲设计0，1，2，3，4，5，6，7这几个数的计数器，如果设计合理，采用同步二进制计数器，最少应使用（）个触发器。 选项： A、4 B、8 C、3 D、2
- 18.不属于时序逻辑电路的计数器进制的为（ ）。 选项： A:二进制计数器 B:十进制计数器 C:N进制计数器 D:脉冲计数器
