将VHDL设计源程序直接送到VHDL仿真器中所进行的仿真，称为（ ）
选项：
A:行为仿真
B:功能仿真
C:时序仿真
发布时间：2024-06-12 11:32:13
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将VHDL设计源程序直接送到VHDL仿真器中所进行的仿真，称为（ ）
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- 1.采用仿真器针对器件的硬件特征进行的仿真称为（ ）。选项： A:时序仿真 B:功能仿真 C:前仿真 D:硬件测试
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- 3.采用仿真器进行的不考虑器件的硬件特征的仿真称为A．时序仿真B．功能仿真C．后仿真D．硬件测试
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- 5.再HDL仿真器中，通常把不考虑硬件延时的仿真称为时序仿真。 选项：A:错误 B:正确
- 6.FPGA开发实现过程包括设计输入、逻辑综合、器件适配、编程下载、功能仿真、时序仿真、硬件测试等步骤，以下正确的设计流程是选项： A:设计输入、功能仿真、逻辑综合、器件适配、时序仿真、编程下载、硬件测试; B:器件适配、编程下载、设计输入、逻辑综合、功能仿真、时序仿真、硬件测试; C:逻辑综合、设计输入、功能仿真、时序仿真、器件适配、编程下载、硬件测试; D:设计输入、器件适配、功能仿真、逻辑综合、编程下载、时序仿真、硬件测试
- 7.下列哪个流程是基于EDA软件的FPGA / CPLD一般设计流程（ ）。选项： A:设计输入->逻辑设计->逻辑综合->功能仿真->布局布线->时序仿真->编程下载; B:逻辑设计->设计输入->逻辑综合->功能仿真->布局布线->时序仿真->编程下载; C:逻辑设计->设计输入->逻辑综合->时序仿真->布局布线->功能仿真->编程下载; D:逻辑设计->设计输入->逻辑综合->布局布线->功能仿真->时序仿真->编程下载
- 8.对设计电路的逻辑功能进行验证被称为（ ）。选项： A:功能仿真; B:时序仿真; C:编程验证; D:逻辑综合
- 9.对设计电路的逻辑功能进行验证被称为（ ）。 选项： A、功能仿真 B、时序仿真 C、编程验证 D、逻辑综合
- 10.下列那个流程是基于EDA软件的FPGA / CPLD一般设计流程（ ）。选项： A:设计输入->逻辑设计->逻辑综合->功能仿真->布局布线->时序仿真->编程下载; B:逻辑设计->设计输入->逻辑综合->功能仿真->布局布线->时序仿真->编程下载; C:逻辑设计->设计输入->逻辑综合->时序仿真->布局布线->功能仿真->编程下载; D:逻辑设计->设计输入->逻辑综合->布局布线->功能仿真->时序仿真->编程下载
- 11.在进行仿真时，不考虑器件的硬件特征的仿真属于（ ）。选项： A:时序仿真 B:功能仿真 C:后仿真 D:硬件测试
- 12.什么是前仿真和后仿真？什么是功能仿真和时序仿真？
- 13.按仿真时是否考虑硬件延时分类,可分为功能仿真和下列哪一个仿真? 选项： A、时序仿真 B、RTL级仿真 C、行为级仿真 D、系统级仿真
- 14.对设计电路的逻辑功能进行验证被称为（ ）。A.功能仿真B.时序仿真C.编程验证D.逻辑综合
- 15.对设计电路的逻辑功能进行验证被称为（ ）。A．功能仿真B．时序仿真C．编程验证D．逻辑综合
- 16.下列哪个流程是基于EDA软件的FPGA / CPLD一般设计流程（ ）。 选项： A、设计输入->逻辑设计->逻辑综合->功能仿真->布局布线->时序仿真->编程下载 B、逻辑设计->设计输入->逻辑综合->功能仿真->布局布线->时序仿真->编程下载 C、逻辑设计->设计输入->逻辑综合->时序仿真->布局布线->功能仿真->编程下载 D、 逻辑设计->设计输入->逻辑综合->布局布线->功能仿真->时序仿真->编程下载
- 17. 时序仿真与功能仿真的区别？
- 18.功能仿真与时序仿真有何区别 ？
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- 21.下面有关仿真说法正确的是：选项： A:功能仿真主要是检查逻辑功能是否正确，不考虑任何延迟信息；; B:功能仿真速度快，适合于复杂大系统的初步功能检查：; C:时序仿真是利用在布局布线中获得的精确延时参数进行的精确仿真；; D:时序仿真速度比较慢；
- 22.基于EDA软件的FPGA/CPLD设计流程为：原理图/HDL文本输入→（ ）→综合→适配→时序仿真→编程下载→硬件测试。 选项： A、配置 B、逻辑综合 C、时序仿真 D、功能仿真
- 23.下列哪个流程是正确的基于EDA软件的FPGA / CPLD设计流程（ ） 选项： A:原理图输入功能仿真适配编程下载综合硬件测试 B:设计输入功能仿真分析综合编程下载硬件测试； C:设计输入分析综合功能仿真编程下载硬件测试 D:设计输入时序仿真功能仿真编程下载硬件测试；
- 24.Emulator为（ ）。选项： A:软件仿真器; B:在线仿真器; C:CCS开发环境; D:链接器
- 25.仿真包括功能仿真和时序仿真，前者不考虑信号延时等因素，后者是在选择具体器件并完成布局布线后进行的包含延时的仿真。（ ）选项： A:对 B:错
