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C54x系列DSP处理器中,实现时钟频率倍频或分频的部件是()。
发布时间:
2024-06-29 00:12:51
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1.
C54x系列DSP处理器中,实现时钟频率倍频或分频的部件是锁相环PLL。()
2.
C54x系列DSP处理器中,实现时钟频率倍频或分频的部件是锁相环PLL。
3.
C54x系列DSP处理器中,实现时钟频率倍频或分频的部件是锁相环PLL。(
)
4.
DSP的流水线冲突产生的原因是由于DSP运行速度还不够快. ( 错 )8。 直接寻址中从页指针的位置可以偏移寻址64个单元. ( 错 )9。 C54x系列DSP处理器中,实现时钟频率倍频或分频的部件是锁相环PLL ( 对 )10。 DSP处理器TMS320VC5509的堆栈是向低地址方向生长的。 ( )
5.
设计基于C54x DSP的嵌入式系统时,通常外部输入时钟选择16MHz、20MHz等较低频率的时钟信号或晶体。此时需要设置C54x DSP的寄存器( )来配置内部的PLL,实现倍频处理,使DSP的CPU工作在更高的工作频率。 注意采用大写字母填写寄存器名称
6.
设计基于C54x DSP的嵌入式系统时,通常外部输入时钟选择16MHz、20MHz等较低频率的时钟信号或晶体。此时需要设置C54x DSP的寄存器( )来配置内部的PLL,实现倍频处理,使DSP的CPU工作在更高的工作频率。 注意采用大写字母填写寄存器名称
7.
C54X系列DSP处理器的累加器A和B是32位的。( )
8.
C54x系列DSP芯片由于其内部CPU采用了( ),因此具有比传统处理器更快的指令执行速度选项: A:冯诺依曼结构和流水线操作; B: 哈佛结构、流水线技术和多总线结构; C:并行操作和多总线结构; D:高时钟频率
9.
PLL锁相环的作用是:精确、稳定时钟频率,且倍频时钟频率
10.
关于TMS320C28x系列DSP芯片的时钟电路,下列说法正确的是 ( )选项: A:F2812 DSP只能使用外部时钟源; B:时钟源一般需经过PLL(锁相环)倍频后方可使用; C:F2812 DSP一共有三个32位CPU定时器,分别是CPUTimer0,CPUTimer1,CPUTimer2; D:DSP芯片比单片机更可靠,所以不需要看门狗电路
11.
关于TMS320C28x系列DSP芯片的时钟电路,下列说法正确的是 ( )选项: A:F2812 DSP只能使用外部时钟源; B:外部时钟源一般需经过PLL(锁相环)倍频后方可使用; C:F2812 DSP一共有两个32位定时器,分别是Timer0,Timer1; D:DSP芯片比单片机更可靠,所以不需要看门狗电路
12.
度量处理器CPU时钟频率的单位是______。
13.
已知时钟信号的频率是50MHz, 若利用该信号进行分频,产生10KHz的脉冲信号,则分频系数是______ 。
14.
TI C54x DSP的DSP程序的扩展名为( )。
15.
关于DSP处理器的说法,正确的是选项: A:DSP最突出的特点就是具有哈佛总线结构核硬件乘法器; B:DSP处理器的低功耗特点使它更适合用于手持移动终端设备中; C:TMS320F28系列DSP处理器可用于控制领域; D:DSP处理器用于数字信号处理性能很好,但一般功耗太大
16.
预分频器可以将计数器的时钟频率按1到65536之间的任意值分频。( )选项: A:对 B:错
17.
定时器时钟寄存器中3位控制位为001代表?选项: A:使用内部时钟且不分频; B:使用外部时钟且不分频; C:使用外部时钟且分频系数为2 ; D:使用内部时钟且分频系数为2
18.
ecap模块计数器的时钟源为( )。? 系统时钟|外部时钟|系统时钟的2分频|系统时钟的任意分频
19.
C6000系列DSP的CPU在一个时钟周期内,最多()条指令并行.
20.
12.STM32定时器6时钟频率为72MHz,能够实现定时时间为1秒的设置是( )。 选项: A、预分频器:71,计数周期:999999 B、预分频器:7199,计数周期:9999 C、预分频器:9999,计数周期:9999 D、预分频器:7200,计数周期:7200
21.
中国大学MOOC: C54x DSP的PMST寄存器的各个位作用不同,以下选项所给出的PMST位中,哪些影响着C54x DSP的存储空间映射?
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