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相关试题
- 1.一个同步时序逻辑电路如果采用宏单元模型来设计，要求该逻辑电路共输出4路信号，而这些输出信号共有7种电平组合，那么至少需要几个D触发器才能实现该设计____。 选项：A、7个 B、4个 C、3个 D、1个
- 2.若要设计一个能产生序列信号001111011的移位寄存器序列信号发生器，则至少需要4个触发器。选项： A:错 B:对
- 3.若要设计一个能产生序列信号001111011的移位寄存器序列信号发生器，则至少需要4个触发器。选项： A:对 B:错
- 4.在数字电路实验中，通常信号发生器输出采用 。
- 5.若要求输出一个稳定的电压信号,设计一个反相比例运算电路能实现,同相比例电路实现不了。
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6.同步时序逻辑电路中各触发器的时钟脉冲CP是同一个信号。
( ) - 7.两信号与cP的时序关系如图1所示。用4位二进制计数器74LVC161、集成单稳74121设计该信号产生电路,试画出电路图
- 8.时钟信号的同步电路一般采用_
- 9.积分电路与微分电路在方波序列脉冲的激励下,其输出信号波形的变化规律如何?
- 10.已知有一个3输入端的门电路,若输入信号A、B、C的波形如图(a)所示,输出信号Y的波形如图(b)所示,则该门电路执行的是()逻辑操作
- 11.设计计数型的序列信号发生器，可以采用多路数据选择器，也可以不采用多路数据选择器。 选项： A:正确; B:错误
- 12.设计0011序列检测器，要求使用Moore电路，使用JK触发器，输出低电平有效。
- 13.【简答题】积分电路与微分电路在方波序列脉冲的激励下,其输出信号波形的变化规律如何?
