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- 1.[单选题]74LS190引脚功能：5脚为（ ） A 使能端，低电平有效 B 计数端，高电平加计数 C 计数端，低电平加计数 D 预置数端，低电平输入预设的数。
- 2.74LS273芯片下面描述正确的是（） 选项： A、该芯片能正常工作时，清零端为低电平时，输出端为低电平。 B、该芯片能正常工作时，清零端为高电平，且其控制端在下跳沿信号来时，将输入端信号锁存。 C、该芯片的主要功能是锁存数据，一次能锁存16位数据。 D、该芯片能正常工作时，清零端为高电平，且其控制端在上跳沿信号来时，将输入端信号锁存。
- 3.74LS273芯片下面描述正确的是（） A: 该芯片能正常工作时，清零端为低电平时，输出端为低电平。 B: 该芯片能正常工作时，清零端为高电平，且其控制端在下跳沿信号来时，将输入端信号锁存。 C: 该芯片的主要功能是锁存数据，一次能锁存16位数据。 D: 该芯片能正常工作时，清零端为高电平，且其控制端在上跳沿信号来时，将输入端信号锁存。
- 4.下图是555定时器的引脚图，以下叙述正确的有A.4管脚为直接清零端，低电平有效 B.4管脚为直接清零端，高电平有效C.5管脚为控制电压输入端，必须接电源 D.5管脚为控制电压输入端，可以通过0.01μF 电容接地
- 5.9号引脚为单片机的复位引脚，复位时需要输入低电平。（ ）选项： A:对 B:错
- 6.MCU的GPIO引脚外接上拉电阻，目的是 选项： A、使得该引脚平时为高电平 B、使得该引脚平时为低电平 C、使得该引脚为输出 D、使得该引脚为输入
- 7.MCU的GPIO引脚外接上拉电阻，目的是 选项： A、使得该引脚平时为高电平 B、使得该引脚平时为低电平 C、使得该引脚为输出 D、使得该引脚为输入
- 8.MCU的GPIO引脚外接上拉电阻，目的是选项： A:使得该引脚平时为高电平; B:使得该引脚平时为低电平; C:使得该引脚为输出; D:使得该引脚为输入
- 9.19.MCU的GPIO引脚外接上拉电阻，目的是 选项： A、使得该引脚为输出 B、使得该引脚平时为低电平 C、使得该引脚平时为高电平 D、使得该引脚为输入
- 10.下图是555定时器的引脚图，以下叙述正确的有[img=145x117]17da6897c4c46df.png[/img] A: 4管脚为直接清零端，高电平有效 B: 5管脚为控制电压输入端，可以通过0.01μF 电容接地 C: 5管脚为控制电压输入端，必须接电源 D: 4管脚为直接清零端，低电平有效
- 11.EoC为ADC0809的转换结束信号,下面说法正确的是( )。 选项： A: 当A/D转换开始时,该引脚为高电平,转换结束时,该引脚为低电平 B: A/D转换开始时到结束,该引脚一直为高电平 C: 当A/D转换开始时,该引脚为低电平,转换结束时,该引脚为高电平 D: A/D转换开始时到结束,该引脚一直为低电平
- 12.某机字长16 位，CPU地址总线18位，数据总线16位，存储器按字编址，CPU 的控制信号线有：MREQ#（存储器访问请求，低电平有效），R/W#（读写控制，低电平为写信号，高电平为读信号）。 已知该机已有8K×16位的ROM存储器，地址处于主存的最高端；现在再用若干个16K×8位的SRAM芯片形成128K×16位的RAM存储区域，起始地址为00000H，假设SRAM芯片有CS#（片选，低电平有效）和WE#（写使能，低电平有效）信号控制端；试写出RAM、ROM的地址范围，并画出SRAM、ROM与CPU的连接图，请标明SRAM芯片个数、译码器的输入输出线、地址线、数据线、控制线及其连接
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13.下图是555定时器的引脚图，以下叙述正确的有
选项： A、4管脚为直接清零端，低电平有效 B、4管脚为直接清零端，高电平有效 C、5管脚为控制电压输入端，必须接电源 D、5管脚为控制电压输入端，可以通过0.01μF 电容接地
- 14.实验所用的 μA741 芯片的同相输入端是号引脚，反相输入端是号引脚，输出端是号引脚
- 15.关于AD0809时序电平描述正确的是（）选项： A:START 为转换启动控制信号，高电平有效; B:ALE为模拟信号输入选通端口地址锁存信号，上升沿有效; C:START 有效以后，状态信号EOC变为低电平; D:转换结束后，EOC转为高电平
- 16.关于AD0809时序电平描述正确的是（）选项： A:START 为转换启动控制信号，高电平有效; B:ALE为模拟信号输入选通端口地址锁存信号，上升沿有效; C:START 有效以后，状态信号EOC变为低电平; D:转换结束后，EOC转为高电平
